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一、崗位職責 1.負責PCIe或USB2.0/3.0相關數(shù)字邏輯開發(fā)，調(diào)試； 2.負責PCIe或USB2.0/3.0自研IP以及第三方IP的整合，集成； 3.負責PCIe或USB2.0/3.0相關的時序，低功耗設計； 4.負責PCIe或USB2.0/3.0相關驗證，芯片測試出現(xiàn)問題的debug。 二、任職要求 1.有扎實的數(shù)字電路設計基礎，熟悉verilog語言； 2.3年以上數(shù)字電路設計工作經(jīng)驗； 3.熟練掌握PCIe或USB2.0/3.0協(xié)議； 4.熟悉PCIe或USB2.0/3.0 IP設計，整合以及調(diào)試； 5.熟悉時序，低功耗設計，理解SDC，UPF； 6.有團隊合作精神，吃苦耐勞的品質(zhì)以及很強的事業(yè)心。